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Sr Staff Engineer, Compiler
- 給与
- 記載なし
- 勤務地
- 東京都小平市
- 休日
- 記載なし
- 雇用形態
- 正社員
- オフィス出社
どんな仕事かAIによる生成
As an AI Compiler Engineer on the Renesas HPC team, this role leads compiler architecture and development for Renesas automotive SoCs. Responsibilities include graph and performance optimization for target NPUs, hardware-software collaboration, performance KPIs for automotive AI workloads, and ensuring compiler outputs meet automotive requirements.
この求人に応募
応募資格
必須
- MS/PhD (or equivalent experience) in Computer Science, EE, or related field
- Deep experience building AI compilers, accelerator backends, or graph optimization frameworks
- Strong expertise in graph optimization and performance optimization for NPUs or custom accelerators
- Experience with MLIR, LLVM, TVM‑like systems, or proprietary compiler IRs
- Excellent C/C++ and Python skills
- Solid understanding of AI inference workloads (CNNs, transformers, perception or generative models)
- Strong communication skills are required, e.g. agile development experience in Scrum team (Scrum Master or member)
歓迎
- Experience with automotive or safety‑critical systems
- Background in heterogeneous SoCs (CPU/GPU/DSP/NPU)
- Performance modeling or hardware–software co‑design experience
募集要項最終確認 10/23
- 職種
- システムエンジニア（SE・SIer）
- 雇用形態
- Full-time
- 役職
- Sr Staff Engineer
- 給与
- 記載なし
- 勤務地
- 東京都小平市
- 働き方
- リモート No
- 学歴
- 大学院修了以上
- 掲載日
- 2026/10/20 23:05（3日前）
- 最終確認
- 2026/10/23 02:51（今日）
仕事内容
Job Description
- As an AI Compiler Engineer on the Renesas HPC team, you will be responsible for driving compiler and code generation technologies that unlock the full compute potential of Renesas next-generation automotive System-on-Chip platforms, including advanced 3 nm silicon for software-defined vehicles (SDVs). Your work will directly impact how AI workloads — from perception and sensor fusion to in-vehicle assistants and advanced driver assistance — are translated into highly optimized, safe, and power-efficient execution on Renesas hardware.
- This role bridges software compiler development, AI model lowering/optimization, and hardware-software co-design, enabling Renesas SoCs to deliver industry-competitive performance, efficiency, and functional safety required by multi-domain automotive applications..
Job Description
- Lead AI compiler architecture across model ingestion, graph optimization, lowering, code generation, and runtime integration
- Design and implement graph‑level optimizations (operator fusion, quantization‑aware rewrites, memory‑aware scheduling, partitioning)
- Drive performance optimization for target NPUs, including tiling, tensor layout, and multi‑core execution strategies
- Partner with SoC and AI accelerator architects to influence hardware features through compiler insights
- Own performance KPIs for real automotive AI workloads using simulators, profilers, and silicon‑correlated models
- Ensure compiler outputs meet automotive requirements (real‑time behavior, determinism, quality expectations)
- Mentor senior engineers and set technical direction without people‑management responsibilities
この求人は、ルネサスエレクトロニクス株式会社の採用ページの内容をAIが読み取って整理したものです。応募の前に採用ページの原文を確かめてください。データの集め方企業サイト
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