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LLM処理を加速するAIアクセラレータLSIの開発【機能ブロック設計・実装・検証】リーダークラス
給与
38.5万円/月〜※ 月給提示。年額は賞与を含まないため算出していません
- 勤務地
- 神奈川県
- 雇用形態
- 正社員
- 働き方
- ハイブリッド勤務
- 年間休日
- 非公開
仕事内容ハードウェアエンジニア
富士通研究所の先端コンピューティング開発本部で、LLM処理を加速する次世代AIアクセラレータLSI-NPUの機能ブロック設計・実装・検証を担当するリーダークラスの募集です。独自アーキテクチャに基づくNPU開発において、論理設計・検証チームを主導し、仕様設計からRTL実装、検証までを統括します。
募集テーマ
- LLM処理を加速するAIアクセラレータLSIの開発【機能ブロック設計・実装・検証】リーダークラス(2名募集)
担当業務・PJ概要
- 当本部では、数多くのサーバー製品、スーパーコンピューター「富岳」や、その一般展開HPC製品向け高性能プロセッサを開発しています。
- 現在、官公庁が推進するポスト5G情報通信システム基盤強化研究開発事業に参画し、超低消費電力AIエージェントプロセッサ開発プロジェクトの一環として、LLM処理を加速する次世代AIアクセラレータLSI-NPU(Neural Processing Unit)-の研究開発を行っています。
- 本件募集では、当本部で討した独自アーキテクチャに基づいたAIアクセラレータを設計開発するにあたり、LSI開発における機能ブロックの論理仕様検討,設計仕様検討,RTL実装,論理検証を担当する社員を募集します。
具体的な業務内容
- NPU開発における機能ブロックの論理仕様策定,設計仕様策定,検証仕様策定,RTL実装,RTL検証
個人に期待する役割やミッション
- NPU開発において、論理設計・検証チームの主要ブロック開発リーダーとして、チームメンバーを主導し、担当機能ブロックの詳細仕様設計、RTL実装、および検証プロセス全体を統括していただきます。
- 専門知識を活かして設計課題の解決と品質向上を推進するとともに、関連する複数の機能ブロック開発チームと密接に連携し、LSI全体の統合と最適化を推進することで、NPUの開発を推進していただきます。
仕事の魅力・やりがい
- 先端技術を利用する次世代AIアクセラレータの開発業務です。目標達成のためにチャレンジしながら、プロジェクト成功のために社内外,国内外のメンバーで協力して開発に取り組みます。
- 最新のEDAツール,先端プロセスを用いたLSIの設計開発に従事できます。
募集要項最終確認 7/25
- 雇用形態
- 正社員
- 想定年収
- 38.5万円/月〜
- 勤務地
- 神奈川県
- 働き方
- ハイブリッド勤務
- 年間休日
- 非公開
- 職種
- ハードウェアエンジニア
- 経験年数
- 不問
- 掲載日
- 7/25
- 最終確認
- 7/25
応募資格(必須)
- RTLを用いた論理回路の設計・検証経験(Verilog/SystemVerilog/SystemCのいずれか)
- 論理回路設計の基礎知識
歓迎する経験
- LSIの開発経験
- 社外デザインハウスを活用した開発経験
- IP提供ベンダとの協調設計経験
- ビジネスレベルの英会話力
待遇・福利厚生
- 業務関連費用会社負担
求めるスキル・経験
この求人は富士通株式会社の採用ページの掲載内容をもとに構成しています。応募条件の最新情報は募集元をご確認ください。
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- LLM処理を加速するAIアクセラレータLSIの開発【機能ブロック設計・実装・検証】メンバークラス
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- 次世代グリーンDC・富岳NEXTプロセッサのアナログ開発
- サーバ装置のハードウェア開発業務(マネージャー)
- AIアクセラレータLSIの開発(機能ブロック設計・実装・検証)サブリーダークラス
募集元の採用ページから応募できます
応募は富士通株式会社の採用ページで受け付けています。このページは採用ページの掲載内容をもとに構成しているため、最新の応募条件は募集元でご確認ください。
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